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Von daher nur eine kleine Bitte, falls du mal dazu kommst: kannst du irgendeinen CineBench Multicore mal machen, wenn du ein stablies Setup mit >8000 fährst?
Danke dir!
Später... die Wochen oder so... steige ich mit ein.
Cinebench skaliert soweit ich weiß sogut wie garnicht mit Ramtakt. Mit meinem aktuellen 8000c38 setting macht mein 8700g in CB23 18800 Punkte mit CO-20.
Ich finde das aktuelle Bios 2.08 stable schlechter als die 2.08beta Versionen die ich getestet habe. Die iGPU Performance ist bei gleichen Settings minimal schlechter geworden.
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5,10,15,20
in der Realität
15,30,45,60....1425,1395,1365,1335
1425mV ist der Letzte HEX-Schritt für den Controller im 5mV step. (incl +/- 5mV margins, also drei richtige optionen)
Danach um 1430mV bzw höher zu erreicheen ändert es sich in 10mV und es beginnt von vorne zu zählen
10,.20,30,40
in der Realität
1430,1460,1490,1520
Bis 2.125v , wenn ich es noch richtig in erinnerung habe
// +/- 15mV, somit weiterhin 3 richtige Schritte
Die Range hat eingehalten zu werden.
Dass man Margins hat, ist hilfreich jedoch nicht selbstverständlich.
Dass du dem Controller jedoch keinen Misst mitteilst, sollte selbstverständlich sein.
Gibt es da Unterlagen zu der "Voltage-Regel"?
Mein 6400 Setting z.B ist bei 1.49v instabil. Bei 1.5v ist es stabil. Bach der Regel ist 1.5v aber "schlecht" und ich müsste auf 1.52v gehen. Das gefällt mir aber nicht
Gibt es da Unterlagen zu der "Voltage-Regel"?
Mein 6400 Setting z.B ist bei 1.49v instabil. Bei 1.5v ist es stabil. Bach der Regel ist 1.5v aber "schlecht" und ich müsste auf 1.52v gehen. Das gefällt mir aber nicht
Drop down wäre klasse. Einmal Vdd und dann per Drop down das Delta um auf Vddq zu kommen👍 @gimme7 die Regel verhindert dass die Spannung fluktuiert. Was nomalerweise negativ ist.Wenn dein Ram mehr Spannung benötigt um Stabil zu sein dann bleibe bei den 1.5. man gewinnt mit der Regel nur zusätzlich stabilität.
soweit ich informiert bin ist das eine ganz alte Information - bis zu 200mV sind AFAIK wohl okay. Ein höheres Delta verbessert gleichzeitig die Signalqualität
Leider fairy tale
JEDEC bzw IC Vendors geben keinen Zielwert für derren ICs an.
Ebenso nicht die PMIC Hersteller.
Das einzige was angegeben wird, ist der maximale Richtwert von (bis 300mV delta innerhalb des Dimm's)
Boardpartner geben "bis 200 delta" an, jedoch ist dies falsch
Lass mich die erste Frage etwas später beantworten.
Es ist wie es ist, da ab dem 10mV mode, keine 5mV Werte eigegeben werden können.
//Jeder einzelne Binary Step ist 10mV lang (groß)
Anstelle (-5, X +5), ändert es sich auf (-10, X, +10) mV
Der PMIC hat weiterhin die Möglichkeit hoch und runter zu skallieren. Muss er damit sich Daten übertragen können.
Aber von der Nutzer sowie Bios Seite, macht es wenig Sinn auch nur zu versuchen die 5mV steps einzuhalten.
Es macht jedoch Sinn gleich selbst in seiner Rechnung zu runden, anstelle dem Board es zu überlassen mit potiental weiterer Bugs
Besonders im OC mode.
Der Rest der Frage wird etwas schwierig zu beantworten sein, da ich zwar JESD-X zitieren kann
Jedoch Richtek sowie Renesas derren PMIC datasheets unter NDA halten. Theoretisch und logisch.
Über den OC mode werde ich dir nicht viel helfen können.
Beitrag automatisch zusammengeführt:
Ah ebenso ein Mythos ist, dass jeweilige Dimm-Vendors die MVDD=MVDDQ "theorie" einhalten müssen.
Es ist einfach eine Angewohnheit, bzw das "Telefon-Problem"
Man hört etwas und nimmt es als Regelwerk an.
Nirgendwo in den Specifications wird erwähnt dass es genau so sein muss. 🤭
da ich eh noch testen wollte, wie weit ich mit der VSoc runter kann, hab ich dann im gleichen Zug meine VDD auf 1.52v und VDDQ 1.50v angepasst. Ich hoffe, ich hab das jetzt richtig verstanden
ok, habs mal so übernommen. Karhu läuft jetzt durch die Nacht mit neuen Spannungen 1.52v / 1,46v. Vorher 1.5v /1.48v seit Wochen stabil.
6400C28-37-37-37-49-86
@Wolf87 regeln für die datenvali -> darstellungsart -> pfeil
erübrigt sich das mit den regelmäßigen 32er schritten für zb trfc nicht ein wenig wenn man nicht glatte 6000mt und/oder den exakten trefi fährt?
trfc hat eine untergrenze, trefi eine temperaturabhängige obergrenze, jeweils siliziumabhängig und eher in ns anstatt clocks.
was wären sozusagen bessere trefi-schritte abseits von z.b. 54000 geht, 55000 aber nicht mehr, und das dazwischen ausloten ist praktisch zeitverschwendung?
as wären sozusagen bessere trefi-schritte abseits von z.b. 54000 geht, 55000 aber nicht mehr, und das dazwischen ausloten ist praktisch zeitverschwendung?
REFI depends on tRET @ target voltage @ target temperaturecase & refresh method.
Even has PCB layers as variable.
REFI 54000 has no binary step for the controller. Neither 55000
Input becomes invalid.
Memory while running in picosec, its not really on our worldclock.
ns targets are silly and only done @ 1.1v where everything scales cleanly (decimal)
Only for QA specification, but still not the way memory operates at. Neither the controllers have such fine granularity.
Even here, there is no way to set anything finer than that.
"nice looking numbers" you see are straight-out wrong. They have no mapping. Controller will not accept them.
Also those values need (value-1) as input, given decimal to hex to binary conversion. Value 0-65535. 0 is then a value.
32767 & 65535 herby are correct values. Same as 40959 & 49151.
To paint a perspective
You know how little 1ns is
1 sec = 1e12 ps & that value is then rounded/aligned with/by Herz.
It cant be thaat fine-granular
It doesnt move in our perceptiveness & even docs can't display that.
Its soo much faster and has to follow a logic.
So ich melde mich auch mal wieder. Habe neues Spielzeug: 2x24GB 6000mhz Expo RAM.
Ich will aber keine lahmen 6000mhz deshalb teste ich grade folgendes durch:
Ich bin noch nicht durch alle Timings zu optimieren aber die meisten sind fertig. Viel geht also nicht mehr. Läuft übrigens mit 1,43V
