RealMax123
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Ich hab mich gerade wieder etwas mit den kommenden Ryzen AI APUs für den Desktop beschäftigt und gelesen das die meisten Mainboards dort genauso wie jetzt schon beim Ryzen 5 8500G nur 4 PCIe Lanes auf den PCIe x16 Slots legen werden.
Aber warum ist das so?
Mir ist schon bewusst das diese APUs nur 14 PCIe Lanes haben und 4 für den Link zum Chipsatz benötigt werden. Das ist wirklich extrem knapp durch AMD konstruiert, aber die logische Aufteilung wäre da doch eher 8+2, also 8 zum PCIe x16 Slot und 2 zum ersten m.2 2280 Slot.
Den Rest könnte man doch über den Chipsatz anbinden, weil selbst der A620 und B840 je 8 eigene Lines bringen, und der B650 und B850 sogar je 12 Lines.
Aber warum ist das so?
Mir ist schon bewusst das diese APUs nur 14 PCIe Lanes haben und 4 für den Link zum Chipsatz benötigt werden. Das ist wirklich extrem knapp durch AMD konstruiert, aber die logische Aufteilung wäre da doch eher 8+2, also 8 zum PCIe x16 Slot und 2 zum ersten m.2 2280 Slot.
Den Rest könnte man doch über den Chipsatz anbinden, weil selbst der A620 und B840 je 8 eigene Lines bringen, und der B650 und B850 sogar je 12 Lines.
