Core Ultra 400: Das sollen die Spezifikationen der Nova-Lake-Desktop-Modelle sein

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Gerüchte zu Nova Lake, der nächsten Generation der Desktop-Prozessoren von Intel, gibt es bereits zahlreich. Bis zu 52 CPU-Kerne, 144 MB an zusätzlichem Cache pro Compute-Tile und vieles mehr sollen den blauen Chipriesen wieder an die Spitze führen.
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Erwähnenswert aus dem videocardz Artikel fänd ich noch

This is great news because Intel is already confirming multi-gen support for the new socket. Not really surprising, but I do not recall roadmaps mentioning this as a feature.

Source: VideoCardz.com

Ansonsten z.T. echt verwirrend das Line Up, bin mal gespannt was denn die Gamer CPUs werden.

Core Ultra 9 22C 6+12+4 P2 8+16 CDIE DS Die Package 65W
Core Ultra 7 24C 8+12+4 P1D 8+16 CDIE DS Die Package 125W

Welcher wird schneller sein? Freu mich aber so langsam wirklich drauf, dieses ganze "Intel will zurück an die Spitze" Gelaber ist echt ansteckend. Mir fehlt zwar (fürs Gaming) noch etwas der Glaube, aber endlich mal wieder ein Kopf an Kopf Rennen wär schon cool.
 
Zuletzt bearbeitet:
Kerne ohne Ende und ein monströser Cache, aber wo wird das alles gefertigt ?
 
Hört sich alles schon sehr interessant an, Gewissheit kommt, wenn Intel im Detail alles vorstellt. Es ist auch gut, dass Intel Fahrt aufnimmt. Wird es K(F, XY)-Modelle geben? Ausbau Grafikeinheit? Usw.
 
So 'n Intel TBA nehme ich gerne. 👍
Hoffentlich hält Intel an seinem Claim fest, die Hyper-Threading Technology wiedereinführen zu wollen.
 
144 MB an zusätzlichem Cache pro Compute-Tile
Nicht zusätzlichem Cache, sondern gesamten L3 Cache!
Ansonsten z.T. echt verwirrend das Line Up, bin mal gespannt was denn die Gamer CPUs werden.

Core Ultra 9 22C 6+12+4 P2 8+16 CDIE DS Die Package 65W
Core Ultra 7 24C 8+12+4 P1D 8+16 CDIE DS Die Package 125W
Das macht keinen Sinn, aber in der Tabelle in der News hier bei HL hat man manchen auch noch Dual Die zugeschrieben, dabei braucht es für diese keine zwei CPU Tiles und in der originalen News sind auch nur die beiden TBA (vermutlich Ultra 9X) wirklich mit zwei CPU Tiles versehen. Da das größte CPU Tile aber 8+16 Cores hat und die 4 LPE Kerne im SoC Tile sein sollen, sind 6+12 oder 8+12 problemlos mit einem CPU Tile zu erzielen und nur für mehr als 28 Kerne braucht man zwei CPU Tiles. In der Tabelle bei VideoCardz scheint das DS Die Package wohl die Tiles mit dem großen 144MB L3 Cache zu beschrieben.

Allerdings scheint die Aufteilung nicht nur bei diesen beiden Modelle komisch zu sein, wieso sollte ein Ultra 7 mehr Kerne als ein Ultra 9 bekommen, sondern auch die Ultra 3 und Ultra 5 scheinen seltsam, denn aktuell hat der Arrow Lake Ultra 3 205 immerhin 4+4 Kerne, der Nachfolger hätte nur noch 2+0+4 und die aktuellen Ultra 5 haben 6+4 oder 6+8 Kerne und würden dann von 4+0+4 bis 6+12+4 reichen, womit der größte Ultra 5 genau so viele Kerne wie der kleinste Ultra 9 hätte und mehr als der kleinste Ultra 7. Das scheint mir doch recht unwahrscheinlich zu sein.
Kerne ohne Ende und ein monströser Cache, aber wo wird das alles gefertigt ?
Meine Vermutung ist, dass die CPU Tiles wohl bei Intel in Intel 18A bzw. wohl der 18A-P Variante gefertigt werden werden. Panther Lake wird dann ja auch schon seit einem Jahr in 18A gefertigt worden sein und das mit maximal 5,1GHz Boosttakt. Da sollte nach einem Jahr Optimierung einiges mehr an Takt machbar sein. Dagegen gibt es noch immer kein Produkt mit einem Chip aus dem TSMCs N2 Prozess zu kaufen, als erstes wird da Apples nächstes iPhone im September erwartet. Da wäre es sehr früh für einen Chip aus der auf höhere Taktraten optimierte CPU aus der N2P Variante des Prozesses noch in diesem Jahr, denn normalerweise dauert es etwa ein Jahr bis der Prozess so weit optimiert worden ist.
Hoffentlich hält Intel an seinem Claim fest, die Hyper-Threading Technology wiedereinführen zu wollen.
Aber nicht bei Nova Lake, die werden nach allen bisherigen Gerüchten kein HT haben, sondern erst Titan Lake mit den Unified Cores. Aber wer braucht bei so vielen Kerne dann noch HT? Dies bringt allenfalls mehr MT Performance, aber dafür gibt es bei Intel ja nun die e-Kerne.
 
Eigentlich langweilig da sich an der Kernzahl und dem Latenzproblem zu den E Kernen nichts ändert. Bei Zen6 gibt es wenigstens den Sprung auf 12 Kerne pro CCD.
Bleibt die Frage was der zusätzliche Cache bringt und wie viele Nieren Intel dafür sehen will.
 
Spannend ist die Aufführung der Tile-Konfigurationen im Zusammenhang mit der jeweiligen Modellserie. Die kleinste Variante sieht vier Performance-Kerne, aber keinerlei Efficiency-Kerne vor

Dass steht in der Tabelle aber anders? Da hat der Core Ultra 3 6 Kerne, zwei P, null E, und 4 LP-E-Cores. Wenn ich das richtig lese....
 
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