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Das setting geladen war der Fehler. Bios reset, alles von Hand neu einstellen.

tRCDRD auf 17 mal testen.

Bios mal neu geflasht? Nur mal ein RAM versucht?

Auf der 1 Seite steht etwas zum Teil.

https://www.guru3d.com/news-story/clocktuner-v2-rc4-for-ryzen-(ctr)-info-and-download.html

Wenn es was fummeliger wird dann wahrscheinlich weniger wegen den Sonoreren als dem 4x 8 GB Setting. Vollbestückung ist nicht immer so einfach.

Ich glaube das CTR sich etwas am AMD Ryzen Master orientiert hat und dann Funktionen hinzugefügt hat. Vielleicht kommt da ja was anderes noch in 2.1+, wer weiß. Morgen soll ja der RC4 kommen. @NCC-1701-A Ja CB20 und 23 nutzen AVX, AVX 2 und AVX 512 soweit ich weiß.

Eigentlich logisch, wenn CTR nicht läuft, dann passiert auch nichts.

Aber die 10 ns Unterschid sind doch gut. Bei gleichem IF

LLC 3 bei 1,25 vcore + offset von ca. 0,035v weiß ich noch.

https://www.computerbase.de/2021-02/amd-agesa-1-2-0-1-ryzen-5000-l3-cache/

AtomicFrost - 32168 Windows 10 x64 - AMD Ryzen 9 5950x | 16/32 PBO 75 @ 4825/4700 + Curve Optimizer - Asus ROG Strix X570-E - 4x8GB DDR4-3800-14-14-14-34

Ich meine da kommt umbenennen, wenn man da drauf klickt.

Wenn es ohne WHEA Fehler oder RAM Test Fehler laufen sollte ist es okay.

Erinnert mich an meinen alten Rechner. Eat this Asus hatte ich mir auch gedacht. :geek:

Curve Optimizer auch aus lassen. Dann weiter testen.

Dann sollte der Clock Tuner for Ryzen etwas für dein Einsatzgebiet sein. So kommst du etwas mehr mit MC hoch. Ich benutze aber POB 175 mit Curve Optimizer für den Alltag.

Aber wann wird nur mal SC benutzt, selbst wenn du zocken solltest wird doch von den Spielen MC gefordert. Oder vertue ich mich da?

Bei Intel Sockel 2066 konnte man wenigstens: Im Group Tuning lassen sich Kerne in mehrere Gruppen einteilen. Beispielsweise in schnell, mittel, langsam, und dann teilt man jedem Kern eine Gruppe zu. Diese Einstellung funktioniert in Tandem mit dem Turbo Boost 3.0 Treiber in Windows.

Weil jetzt max. 8 Kerne in einem CCX zusammen gepackt werden in ein CCD. Und jetzt können sie auf den größeren LL3 cache drauf zugreifen. Durch den ganzen Aufbau konnte man jetzt so ca. 10 ns die Latenz drücken.