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Toshiba und Western Digital bringen 3D-NAND mit 64 Lagen

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toshibaAktuelle 3D-NAND-Bausteine werden bei Micron und Samsung noch mit maximal 48 Lagen gefertigt. Dies wird sich laut Toshiba und Western Digital aber bald ändern, denn die beiden Unternehmen haben die Pilot-Produktion von 3D-NAND mit 64 Lagen angekündigt. Die Speicherhersteller haben den neuen Baustein mit der Bezeichnung BiCS3 versehen und somit gilt dieser als direkter Nachfolger für den BiCS2-NAND mit seinen 48 Lagen.

Durch die höhere Anzahl an Lagen soll sich die Kapazität gegenüber dem Baustein mit 48 Lagen um 40 % erhöhen. Gleichzeitig werden die Produktionskosten geringer ausfallen, da pro Wafer mehr Chips hergestellt werden können. Wie bisher, wird der Speicher auf die TLC-Technik zurückgreifen und damit pro Bit drei Zustände speichern können. Insgesamt sollen die Chips eine Speicherkapazität von bis zu 256 Gigabit aufweisen und somit mit dem V-NAND von Samsung mit seinen 48 Lagen gleichziehen.

toshiba BiCS3 FLASH

Die Produktion des neuen BiCS3-Speichers erfolgt in der vor kurzem eröffneten Fab 2. Wie bereits erwähnt, handelt es sich dabei jedoch noch um Musterchips. Die Massenproduktion sei erst für das erste Halbjahr 2017 geplant. In Zukunft sei der nächste Schritt dann auf Basis der BiCS3-Bausteine einen QLC-Speicher zu entwickeln. Hier sollen im Gegensatz zum TLC-Speicher nicht nur drei, sondern vier Zustände pro Bit gespeichert werden können und damit die Speicherdichte nochmals erhöht werden.

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Kommentare (5)

#1
Registriert seit: 06.04.2003
Bremen
Oberleutnant zur See
Beiträge: 1329
Das dauert fast noch ein Jahr bis zur Massenproduktion sonst nicht schlecht wenn die Preise stimmen.

klein
#2
Registriert seit: 05.07.2010

Admiral
Beiträge: 12093
Und bis die ersten SSDs mit den NANDs im Laden stehen, habe die anderen NAND Hersteller oder zumindest Samsung wohl schon nachgezogen oder gar mehr als 64 Layer realisiert.
#3
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Registriert seit: 02.06.2008

Oberstabsgefreiter
Beiträge: 406
3 bzw. 4 Zustände pro Bit? Interessante Vorstellung, Redundanz einzubauen..^^ in der Quelle steht 3 bit per cell, ich vermute, das ist gemeint.
#4
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Registriert seit: 29.01.2010

Fregattenkapitän
Beiträge: 2627
QLC (also 4Bit/Zelle) wird die Lebenserwartung der SSD wohl weiter senken und die Fehleranfälligkeit weiter erhöhen. Mal sehen wo das noch hinführt. Ich hoffe, dass die aktuelle Technik der Flashspeicher bald durch etwas weniger anfälliges ersetzt wird und nicht immer weiter ausgereizt.

Waren bei SLC die Zellen noch quasi unendlich beschreibbar, sank die Lebensdauer bei MLC auf ca. 1000 Schreibzyklen/Zelle. Später, mit kleineren Strukturen las ich mal von 300. Wie weit sind wir mit TLC resp. später dann QLC?
#5
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Registriert seit: 24.06.2010

Flottillenadmiral
Beiträge: 5271
Den Quatsch mit den 3/4 Zuständen pro Bit habt ihr schonmal dieses Jahr geschrieben. Ich meine, jeder darf auch mal Fehler machen und niemand ist unfehlbar. Aber als Newsredakteur einer großen deutschen Hardwaresite sollte man schon den Unterschied zwischen Bit,Zelle und der Anzahl der Zustände begriffen haben.

http://www.hardwareluxx.de/index.php/artikel/hardware/storage/37323-eine-uebersicht-ueber-aktuelle-technologien-bei-ssds.html?start=3

oder einfach den Herrn Ober fragen =)
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